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标题: 关于寄存器的不解 [打印本页]

作者: 867848512 时间: 2014-12-26 01:05
标题: 关于寄存器的不解
本人小白，想知道，假设PWMCTL让0、1路PWM合并，那么管脚3、4的PWM1和PWM0的波形是

WM1有，PWM0没有，还是两路都有？能告诉我两个管脚输出的波形吗(合并后的)？ps：目前手头没有示波器

作者: Vince_。 时间: 2014-12-26 07:35
两路级联，只有前面的可以输出。如果是XS的话，34是不可以联

作者: 空有一人 时间: 2014-12-26 09:56
顶楼上
PWM Control Register (PWMCTL) PWM 控制寄存器
 CON67：通道 6 和通道 7 的联接控制位，置 0——通道 6 和通道 7 被分成两个 8 位
的
PWM 通道使用。置 1——通道 6 和通道 7 联接起来作为一个 16 位的 PWM 通道使
用，通道 6 作高位字节，通道 7 作低位字节，通道 7 的输出引脚被作为 16 位 PWM
波形的输出引脚。通道 7 的时钟选择位决定时钟源的选择，通道 7 的极性选择位决定
波形的极性，通道 7 的使能位使能 PWM 的输出，通道 7 的中央对齐选择位决定对齐
模式。
 CON45：通道 4 和通道 5 的联接控制位，置 0——通道 4 和通道 5 被分成两个 8 位
的
PWM 通道使用。置 1——通道 4 和通道 5 联接起来作为一个 16 位的 PWM 通道使
用，通道 4 作高位字节，通道 5 作低位字节，通道 5 的输出引脚被作为 16 位 PWM
波形的输出引脚。通道 5 的时钟选择位决定时钟源的选择，通道 5 的极性选择位决定
波形的极性，通道 5 的使能位使能 PWM 的输出，通道 5 的中央对齐选择位决定对齐
模式。
 CON23：通道 2 和通道 3 的联接控制位，置 0——通道 2 和通道 3 被分成两个 8 位
的
PWM 通道使用。置 1——通道 2 和通道 3 联接起来作为一个 16 位的 PWM 通道使
用，通道 2 作高位字节，通道 3 作低位字节，通道 3 的输出引脚被作为 16 位 PWM
波形的输出引脚。通道 3 的时钟选择位决定时钟源的选择，通道 3 的极性选择位决定
波形的极性，通道 3 的使能位使能 PWM 的输出，通道 3 的中央对齐选择位决定对齐
模式。
 CON01：通道:0 和通道 1 的联接控制位，置 0——通道 0 和通道 1 被分成两个 8 位
的
PWM 通道使用。置 1——通道 0 和通道 1 联接起来作为一个 16 位的 PWM 通道使
用，通道 0 作高位字节，通道 1 作低位字节，通道 1 的输出引脚被作为 16 位 PWM
基于飞思卡尔 MC9S12XS128MCU 的模块讲解及测试安徽工业
大学自动化系刘昌元
波形的输出引脚。通道 1 的时钟选择位决定时钟源的选择，通道 1 的极性选择位决定
波形的极性，通道 1 的使能位使能 PWM 的输出，通道 1 的中央对齐选择位决定对齐
模式。
 PSWAI：置 1——关闭了预分频器的输入时钟，可以让 MCU 进入等待模式后实现低
功耗。置 0——在 MCU 进入等待模式后，允许时钟进入预分频器
 PFREZ：置 0——冻结模式下允许 PWM 继续置 1——冻结模式下关闭 PWM 的输
入到预分频器的时钟，这对于仿真比较有利

作者: 衡门之下 时间: 2014-12-26 11:28

空有一人发表于 2014-12-26 09:56
顶楼上
PWM Control Register (PWMCTL) PWM 控制寄存器
 CON67：通道 6 和通道 7 的联接控制位， ...

问一下，如果通道6，7连的话，7作为pwm的输出引脚，输出pwm波形，那此时pwm6输出的波形是和7一样吗？还是其他的？

作者: 空有一人 时间: 2014-12-26 20:54

衡门之下发表于 2014-12-26 11:28
问一下，如果通道6，7连的话，7作为pwm的输出引脚，输出pwm波形，那此时pwm6输出的波形是和7一样吗？还是 ...

6应该是什么都没有，最好还是示波器测下

作者: 867848512 时间: 2014-12-26 23:39

空有一人发表于 2014-12-26 20:54
6应该是什么都没有，最好还是示波器测下

谢谢

作者: 支点305 时间: 2014-12-27 13:35
01级联只有1输出 23只有3 后面同理

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